特征

JEDEC标准

内部流水线双数据速率架构，每个时钟周期两次数据访问

双向数据选通（DQS）

没有DLL；CLK到DQS不同步。

差分时钟输入（CLK和）

四行操作

CAS延迟：2，3突发类型：顺序和中断

突发长度：2、4、8

特殊功能支持

-DS（驱动力）

-深度断电模式（DPD模式）

除数据和DM外的所有输入都在系统时钟（CLK）的上升沿取样

DQS与读取数据边缘对齐；与写入数据中心对齐

仅用于写屏蔽的数据屏蔽（DM）

VDD/VDDQ=1.7V~1.95V自动自刷新

15.6us刷新间隔（64ms刷新周期，4K周期）

LVCMOS兼容输入

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